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* Copyright (c) 2024 Junho Lee <junho@tsnlab.com>
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* SPDX-License-Identifier: Apache-2.0
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#define DT_DRV_COMPAT brcm_brcmstb_gpio
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#include <zephyr/arch/common/sys_bitops.h>
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#include <zephyr/arch/cpu.h>
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#include <zephyr/device.h>
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#include <zephyr/drivers/gpio.h>
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#include <zephyr/drivers/gpio/gpio_utils.h>
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#define GIO_DATA 0x04
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#define GIO_IODIR 0x08
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#define DEV_CFG(dev) ((const struct gpio_brcmstb_config *)(dev)->config)
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#define DEV_DATA(dev) ((struct gpio_brcmstb_data *)(dev)->data)
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struct gpio_brcmstb_config {
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struct gpio_driver_config common;
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DEVICE_MMIO_NAMED_ROM(reg_base);
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mem_addr_t offset;
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};
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struct gpio_brcmstb_data {
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struct gpio_driver_data common;
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DEVICE_MMIO_NAMED_RAM(reg_base);
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mem_addr_t base;
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};
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static int gpio_brcmstb_pin_configure(const struct device *port, gpio_pin_t pin, gpio_flags_t flags)
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{
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struct gpio_brcmstb_data *data = port->data;
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if (flags & (GPIO_SINGLE_ENDED | GPIO_PULL_UP | GPIO_PULL_DOWN)) {
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return -ENOTSUP;
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}
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if (flags & GPIO_INPUT) {
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sys_set_bit(data->base + GIO_IODIR, pin);
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} else if (flags & GPIO_OUTPUT) {
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sys_clear_bit(data->base + GIO_IODIR, pin);
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if (flags & GPIO_OUTPUT_INIT_HIGH) {
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sys_set_bit(data->base + GIO_DATA, pin);
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} else if (flags & GPIO_OUTPUT_INIT_LOW) {
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sys_clear_bit(data->base + GIO_DATA, pin);
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}
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}
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return 0;
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}
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static int gpio_brcmstb_port_get_raw(const struct device *port, gpio_port_value_t *value)
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{
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struct gpio_brcmstb_data *data = port->data;
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*value = sys_read32(data->base + GIO_DATA);
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return 0;
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}
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static int gpio_brcmstb_port_set_masked_raw(const struct device *port, gpio_port_pins_t mask,
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gpio_port_value_t value)
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{
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struct gpio_brcmstb_data *data = port->data;
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sys_clear_bits(data->base + GIO_DATA, mask);
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sys_set_bits(data->base + GIO_DATA, (value & mask));
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return 0;
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}
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static int gpio_brcmstb_port_set_bits_raw(const struct device *port, gpio_port_pins_t pins)
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{
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struct gpio_brcmstb_data *data = port->data;
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sys_set_bits(data->base + GIO_DATA, pins);
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return 0;
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}
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static int gpio_brcmstb_port_clear_bits_raw(const struct device *port, gpio_port_pins_t pins)
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|
{
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struct gpio_brcmstb_data *data = port->data;
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sys_clear_bits(data->base + GIO_DATA, pins);
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return 0;
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}
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static int gpio_brcmstb_port_toggle_bits(const struct device *port, gpio_port_pins_t pins)
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{
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struct gpio_brcmstb_data *data = port->data;
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uint32_t reg_data;
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reg_data = sys_read32(data->base + GIO_DATA);
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reg_data ^= pins;
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sys_write32(reg_data, data->base + GIO_DATA);
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return 0;
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}
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static const struct gpio_driver_api gpio_brcmstb_api = {
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.pin_configure = gpio_brcmstb_pin_configure,
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.port_get_raw = gpio_brcmstb_port_get_raw,
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|
.port_set_masked_raw = gpio_brcmstb_port_set_masked_raw,
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|
.port_set_bits_raw = gpio_brcmstb_port_set_bits_raw,
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|
.port_clear_bits_raw = gpio_brcmstb_port_clear_bits_raw,
|
|
.port_toggle_bits = gpio_brcmstb_port_toggle_bits,
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|
};
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int gpio_brcmstb_init(const struct device *port)
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{
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const struct gpio_brcmstb_config *config = port->config;
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struct gpio_brcmstb_data *data = port->data;
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DEVICE_MMIO_NAMED_MAP(port, reg_base, K_MEM_CACHE_NONE);
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data->base = DEVICE_MMIO_NAMED_GET(port, reg_base) + config->offset;
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return 0;
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}
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#define GPIO_BRCMSTB_INIT(n) \
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static struct gpio_brcmstb_data gpio_brcmstb_data_##n; \
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static const struct gpio_brcmstb_config gpio_brcmstb_cfg_##n = { \
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.common = {.port_pin_mask = GPIO_PORT_PIN_MASK_FROM_DT_INST(0)}, \
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|
DEVICE_MMIO_NAMED_ROM_INIT(reg_base, DT_INST_PARENT(n)), \
|
|
.offset = DT_INST_REG_ADDR(n), \
|
|
}; \
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|
\
|
|
DEVICE_DT_INST_DEFINE(n, gpio_brcmstb_init, NULL, &gpio_brcmstb_data_##n, \
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|
&gpio_brcmstb_cfg_##n, PRE_KERNEL_1, CONFIG_GPIO_INIT_PRIORITY, \
|
|
&gpio_brcmstb_api);
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|
DT_INST_FOREACH_STATUS_OKAY(GPIO_BRCMSTB_INIT)
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