zephyr/dts/riscv/qemu/virt-riscv32.dtsi

/*
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 */

/dts-v1/;

#include <qemu/virt-riscv.dtsi>

/ {
	cpus {
		cpu@0 {
			riscv,isa = "rv32gc";
		};

		cpu@1 {
			riscv,isa = "rv32gc";
		};

		cpu@2 {
			riscv,isa = "rv32gc";
		};

		cpu@3 {
			riscv,isa = "rv32gc";
		};

		cpu@4 {
			riscv,isa = "rv32gc";
		};

		cpu@5 {
			riscv,isa = "rv32gc";
		};

		cpu@6 {
			riscv,isa = "rv32gc";
		};

		cpu@7 {
			riscv,isa = "rv32gc";
		};
	};
};