HV: fix uart hang issue caused by bdf overridden
On a PCI type HV uart, the bdf value is in a union together with mmio_base_vaddr, then the value would be overridden by mmio_base_addr in uart16550_init(), result in is_pci_dbg_uart() returns a wrong value and then uart hang. Tracked-On: #5288 Signed-off-by: Victor Sun <victor.sun@intel.com> Acked-by: Eddie Dong <eddie.dong@intel.com>
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feb0772a53
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8b86714af8
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@ -20,8 +20,13 @@ struct console_uart {
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enum serial_dev_type type;
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union {
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uint16_t port_address;
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union {
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struct {
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union pci_bdf bdf;
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void *cached_mmio_base_va;
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} pci;
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void *mmio_base_vaddr;
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} mmio;
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};
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spinlock_t rx_lock;
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@ -41,14 +46,14 @@ static struct console_uart uart = {
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static struct console_uart uart = {
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.enabled = true,
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.type = PCI,
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.bdf.value = CONFIG_SERIAL_PCI_BDF,
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.mmio.pci.bdf.value = CONFIG_SERIAL_PCI_BDF,
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.reg_width = 4,
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};
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#elif defined(CONFIG_SERIAL_MMIO_BASE)
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static struct console_uart uart = {
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.enabled = true,
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.type = MMIO,
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.mmio_base_vaddr = (void *)CONFIG_SERIAL_MMIO_BASE,
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.mmio.mmio_base_vaddr = (void *)CONFIG_SERIAL_MMIO_BASE,
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.reg_width = 1,
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};
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#endif
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@ -63,9 +68,9 @@ static inline uint32_t uart16550_read_reg(struct console_uart uart, uint16_t reg
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if (uart.type == PIO) {
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return pio_read8(uart.port_address + (reg_idx * uart.reg_width));
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} else if (uart.type == PCI) {
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return mmio_read32(uart.mmio_base_vaddr + (reg_idx * uart.reg_width));
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return mmio_read32(uart.mmio.pci.cached_mmio_base_va + (reg_idx * uart.reg_width));
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} else {
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return mmio_read8(uart.mmio_base_vaddr + (reg_idx * uart.reg_width));
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return mmio_read8(uart.mmio.mmio_base_vaddr + (reg_idx * uart.reg_width));
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}
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}
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@ -77,9 +82,9 @@ static inline void uart16550_write_reg(struct console_uart uart, uint32_t val, u
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if (uart.type == PIO) {
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pio_write8(val, uart.port_address + (reg_idx * uart.reg_width));
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} else if (uart.type == PCI) {
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mmio_write32(val, uart.mmio_base_vaddr + (reg_idx * uart.reg_width));
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mmio_write32(val, uart.mmio.pci.cached_mmio_base_va + (reg_idx * uart.reg_width));
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} else {
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mmio_write8(val, uart.mmio_base_vaddr + (reg_idx * uart.reg_width));
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mmio_write8(val, uart.mmio.mmio_base_vaddr + (reg_idx * uart.reg_width));
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}
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}
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@ -121,20 +126,33 @@ static void uart16550_set_baud_rate(uint32_t baud_rate)
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void uart16550_init(bool early_boot)
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{
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void *mmio_base_va = NULL;
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if (!uart.enabled) {
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return;
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}
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if (!early_boot && (uart.type != PIO)) {
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uart.mmio_base_vaddr = hpa2hva(hva2hpa_early(uart.mmio_base_vaddr));
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||||
hv_access_memory_region_update((uint64_t)uart.mmio_base_vaddr, PDE_SIZE);
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if (!early_boot) {
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if (uart.type == MMIO) {
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mmio_base_va = hpa2hva(hva2hpa_early(uart.mmio.mmio_base_vaddr));
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} else if (uart.type == PCI) {
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||||
mmio_base_va = hpa2hva(hva2hpa_early(uart.mmio.pci.cached_mmio_base_va));
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||||
}
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||||
if (mmio_base_va != NULL) {
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||||
hv_access_memory_region_update((uint64_t)mmio_base_va, PDE_SIZE);
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}
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return;
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}
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/* if configure serial PCI BDF, get its base MMIO address */
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if (uart.type == PCI) {
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uart.mmio_base_vaddr =
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hpa2hva_early(pci_pdev_read_cfg(uart.bdf, pci_bar_offset(0), 4U) & PCIM_BAR_MEM_BASE);
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||||
uart.mmio.pci.cached_mmio_base_va =
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||||
hpa2hva_early(pci_pdev_read_cfg(uart.mmio.pci.bdf, pci_bar_offset(0), 4U) & PCIM_BAR_MEM_BASE);
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||||
if (uart.mmio.pci.cached_mmio_base_va == NULL) {
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/* in case the PCI UART BAR is reset to 0 after boot */
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uart.enabled = false;
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return;
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}
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}
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||||
spinlock_init(&uart.rx_lock);
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spinlock_init(&uart.tx_lock);
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@ -223,10 +241,10 @@ void uart16550_set_property(bool enabled, enum serial_dev_type uart_type, uint64
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if (uart_type == PIO) {
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uart.port_address = data;
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} else if (uart_type == PCI) {
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uart.bdf.value = data;
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uart.mmio.pci.bdf.value = data;
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uart.reg_width = 4;
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||||
} else if (uart_type == MMIO) {
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||||
uart.mmio_base_vaddr = (void *)data;
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||||
uart.mmio.mmio_base_vaddr = (void *)data;
|
||||
uart.reg_width = 1;
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||||
}
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}
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@ -236,7 +254,7 @@ bool is_pci_dbg_uart(union pci_bdf bdf_value)
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bool ret = false;
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if (uart.enabled && (uart.type == PCI)) {
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if (bdf_value.value == uart.bdf.value) {
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if (bdf_value.value == uart.mmio.pci.bdf.value) {
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ret = true;
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}
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}
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